GE DS200DSPCH1A DS200DSPCH1ADA DIGITAL Signalprozessor

 

Über den DS200dspch1ada

DS200DSPCH1ADAist eine digitale Signalprozessor -Steuerplatine, die von General Electric als Teil der in GE Speedtronic Control Systems verwendeten Mark V -Serien hergestellt und entwickelt wurde. Die DS200DSPC-Karte (DSPC) ist eine Hochleistungsprozessorplatine, die auf einem digitalen Signalprozessor basiert, der Rechenkapazitäts- und Kommunikationsbandbreite für die direkte Kontrolle von Leistungsanwendern mit leistungsstarken Stromversorgern wie ununterbrochene Leistungsquellen (UPS), aktive Filter, Dynamometer, windelerregende Leistungsquellen sowie große Auftriebsbücher-Konverters bietet. Das Board steckt in einen Schlitz eines VME -Racks, nimmt jedoch zwei Platzplätze ein (für die Menge von ein bis vier Daughterboards). Die DSPC -Karte kann als Master- oder Slave -Gerät dienen, bietet jedoch ihren Programmspeicher und die erweiterbare lokale Hochgeschwindigkeits -E\/A für die direkte Schnittstelle zur Steuerung von Signalen, ohne den VME -Datenapath zu verwenden.

• Die DSPC -Karte bietet optionale VME -Bus -Schnittstellenanschlüsse (P1 und P2), die mit den GE Fanuc 90\/70 programmierbaren Logik -Controllern (SPS) kompatibel sind. Die DSPC-Platine kann als A24\/D16-VME-Bus-Sklave mit einer 8K-SRAM-Schnittstelle mit zwei Portionen fungieren.
• Das Board kann auch als VME -Bus -Master fungieren, um einen Busübertragungszyklus einschließlich Bus -Schiedsverfahren einzuleiten. Der VME -Bus -Zugriff wird in einem konfigurierbaren statischen Zufallszugriffsspeicher (SRAM) -basierten Feldprogrammiergate -Array -Gerät (FPGA) gesteuert.
• Die Konfigurationsinformationen der Busschnittstelle befinden sich in einem programmierbaren Logikgerät, das nach Bedarf für eine bestimmte Anwendung neu konfiguriert werden kann (diese Methode minimiert manuelle Springer). Die VME-Bus-E\/A ist asynchron und eine Zeitüberschreitung für nicht antwortende Adressen.
• Programm- und FPGA-Logikkonfigurationsdaten werden im Flash-Speicher auf einem abnehmbaren Simms gespeichert, während konfigurierbare Elemente für Anwendungen in einem Sockel-montierten EEPROM gespeichert werden. Der Programmcode wird nach dem Start vom Hochgeschwindigkeits-Static RAM ausgeführt.
• Flash EPROM erleichtert das Herunterladen und Aktualisieren des Elektrokoduscodes der Anwendung und des EPLD-Logiks (Lobable Programmable Logic Device). Die Logik konzentriert sich auf eine Kombination aus sram-basierten FPGAs und EPLD-programmierbaren Logikgeräten.
• Programmierbare Geräte in der Oberfläche werden für die Bereitschaftsgenerierung, die Auswahl der Chips und die Startkontrolle verwendet (diese Geräte werden durch eine serielle Grenzfläche "In-System programmierbar [ISP]) programmiert).

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